Plltxe.
@plltxe · Post #5883 · 12/03/2026 00:00
Either my understanding of #Bidi is off, or Jordan Police screw up their Bidi RT: https://twitter.com/Police_Jo/status/2031410145427616135#RTL🐟
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Chaîne source @OnePlusGuide · Post #2028 · 15 févr.
~ Aggiornamento HavocOS 2.2 del 15 febbraio ~ #Havocos • Nuova implementazione del display ambient • Aggiunto il color picker per lo sfondo del tema • Aggiunto l'AOD in ricarica • Aggiunta l'opzione dell'accento per i Quick Settings • Aggiunto feedback aptico per le gestures OnePlus • Aggiunto l'home button wake per alcuni dispositivi • Riorganizzazione delle impostazioni Havoc • Migliorata la UI • Rimozione della musica ambient dalla schermata di blocco • Aggiustati i toast con le lingue RTL • Aggiustato il gradient dei QS con l'header attivo • Rimossi i glitch con il music ticker • Aggiustato il layout della navbar compatta • Aggiustata la finestra dell'autofill con il tema scuro • Aggiustato il tema scuro del wellbeing Le modifiche saranno integrate in tutte le builds uscite a partire da ora. Come al solito, pubblicheremo qui le nuove uscite. Pierre
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GitHub Trends
@githubtrending · Post #15220 · 14/10/2025 13:00
#verilog#cocotb#embedded#fpga#iss#risc_v#rtl#verilator#verilog#vpn#vproc#wireguard This project creates an open-source, hardware-based WireGuard VPN using an affordable FPGA board, making fast and secure VPNs more accessible. Unlike slow software VPNs or costly proprietary hardware, this FPGA design runs WireGuard encryption and packet processing at near wire speed without needing a PC host. It uses common tools and languages (SystemVerilog, open-source FPGA tools) and includes a soft CPU for control tasks and hardware logic for data encryption and routing. This means you get a faster, more efficient, and customizable VPN solution that is open and affordable, ideal for learning, development, or deployment in cost-sensitive environments. https://github.com/chili-chips-ba/wireguard-fpga