@plltxe · Post #5883 · 12/03/2026, 00:00
Either my understanding of #Bidi is off, or Jordan Police screw up their Bidi RT: https://twitter.com/Police_Jo/status/2031410145427616135#RTL🐟
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Canale sorgente @WritingWay · Post #1217 · 27 mag
RIPASSIAMO DUE REGOLE ✍🏻 Le regole? Le sappiamo, ma a volte le scordiamo. Allora, oggi ecco un mini ripasso. #scrittura#writingtips 1️⃣La regola della "d" eufonica. ✍🏻 La congiunzione “ed” (con “d” eufonica) si usa solo quando la parola che segue comincia per “e” (per esempio: ed ella disse…) in tutti gli altri casi si usa solo “e” (lo stesso vale per ad – a). 2️⃣L'accento acuto. ✍🏻 Le congiunzioni e avverbi come - perché - poiché - affinché - sicché - finché - dopodiché e simili, hanno tutti l’accento acuto sulla “e” finale (é) non grave (è). ❇️ La buona scrittura è anche cura della forma. @writingway 🙌Se ti è piaciuto questo post e pensi possa interessare ad altri, inoltralo cliccando sulla freccia a destra.
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@plltxe · Post #5883 · 12/03/2026, 00:00
Either my understanding of #Bidi is off, or Jordan Police screw up their Bidi RT: https://twitter.com/Police_Jo/status/2031410145427616135#RTL🐟
@githubtrending · Post #15220 · 14/10/2025, 13:00
#verilog#cocotb#embedded#fpga#iss#risc_v#rtl#verilator#verilog#vpn#vproc#wireguard This project creates an open-source, hardware-based WireGuard VPN using an affordable FPGA board, making fast and secure VPNs more accessible. Unlike slow software VPNs or costly proprietary hardware, this FPGA design runs WireGuard encryption and packet processing at near wire speed without needing a PC host. It uses common tools and languages (SystemVerilog, open-source FPGA tools) and includes a soft CPU for control tasks and hardware logic for data encryption and routing. This means you get a faster, more efficient, and customizable VPN solution that is open and affordable, ideal for learning, development, or deployment in cost-sensitive environments. https://github.com/chili-chips-ba/wireguard-fpga