Plltxe.
@plltxe · Post #5883 · 12/03/2026, 00:00
Either my understanding of #Bidi is off, or Jordan Police screw up their Bidi RT: https://twitter.com/Police_Jo/status/2031410145427616135#RTL🐟
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Canale sorgente @WritingWay · Post #1220 · 20 giu
RICORDATEVI CHE ✍🏻 #scrittura#writingtips 1️⃣Si scrive un po’ e non un pò✍🏻 Po’ sta al posto di poco si tratta quindi di un troncamento. Il segno grafico che ne deriva è l’apostrofo e non l’accento. 2️⃣Si scrive un altro e non un'altro ✍🏻 Un è articolo indeterminavo maschile singolare che si usa davanti a tutte le parole che iniziano per vocale, non si apostrofa mai. 3️⃣Né o ne? Né come negazione (es.: né l’uno né l’altro) vuole l’accento acuto, ma se usato come pronome (es.: ne prenderò uno) o come avverbio di luogo (sta’ in camera tua e non ne uscire fino a domani!) non è accentato. ❇️ La buona scrittura è anche cura della forma. @writingway 🙌Se ti è piaciuto questo post e pensi possa interessare ad altri, inoltralo cliccando sulla freccia a destra.
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@githubtrending · Post #15220 · 14/10/2025, 13:00
#verilog#cocotb#embedded#fpga#iss#risc_v#rtl#verilator#verilog#vpn#vproc#wireguard This project creates an open-source, hardware-based WireGuard VPN using an affordable FPGA board, making fast and secure VPNs more accessible. Unlike slow software VPNs or costly proprietary hardware, this FPGA design runs WireGuard encryption and packet processing at near wire speed without needing a PC host. It uses common tools and languages (SystemVerilog, open-source FPGA tools) and includes a soft CPU for control tasks and hardware logic for data encryption and routing. This means you get a faster, more efficient, and customizable VPN solution that is open and affordable, ideal for learning, development, or deployment in cost-sensitive environments. https://github.com/chili-chips-ba/wireguard-fpga