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Canale sorgente @WritingWay · Post #803 · 16 gen

⁣I PRINCIPALI PROBLEMI DEI TESTI SONO QUESTI Fare editing ad un testo non significa soltanto valutarne la forma, trovare gli errori ortografici, sintattici e grammaticali – questo lo può fare il correttore di bozze – ma anche testarne efficacia e leggibilità. In una parola: vagliare le sue potenzialità per un’eventuale pubblicazione sia che si tratti di post o articolo sia di un romanzo o un manuale. Gli aspetti di cui tenere conto sono tanti e nel mio quotidiano lavoro di editor mi accorgo che alcune problematiche sono diffuse e riscontrabili in molte delle opere che analizzo. Nell'articolo che condivido con te potrai trovare alcuni fra i principali problemi che i testi presentano nel quotidiano e con maggiore frequenza. 👩‍💼@AlessandraPerotti #scrivere#scrittura#editing

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#scrivere #scrittura #editing

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Plltxe.

@plltxe · Post #5883 · 12/03/2026, 00:00

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Either my understanding of #Bidi is off, or Jordan Police screw up their Bidi RT: https://twitter.com/Police_Jo/status/2031410145427616135#RTL🐟

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GitHub Trends

@githubtrending · Post #15220 · 14/10/2025, 13:00

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#verilog#cocotb#embedded#fpga#iss#risc_v#rtl#verilator#verilog#vpn#vproc#wireguard This project creates an open-source, hardware-based WireGuard VPN using an affordable FPGA board, making fast and secure VPNs more accessible. Unlike slow software VPNs or costly proprietary hardware, this FPGA design runs WireGuard encryption and packet processing at near wire speed without needing a PC host. It uses common tools and languages (SystemVerilog, open-source FPGA tools) and includes a soft CPU for control tasks and hardware logic for data encryption and routing. This means you get a faster, more efficient, and customizable VPN solution that is open and affordable, ideal for learning, development, or deployment in cost-sensitive environments. https://github.com/chili-chips-ba/wireguard-fpga

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#verilog #cocotb #embedded #fpga #iss #risc_v #rtl #verilator #vpn #vproc #wireguard